Декада рис. 4,а работает в весовом коде 1 — 2 — 4 — 8. Декада на D-тригге-рах, схема которой приведена на рис. 5,а, работает в невесовом коде. Временная диаграмма ее работы приведена на рис. б,б.
Интегральная микросхема К.155ИЕ1 является делителем частоты на 10. Цоколевка микросхемы приведена на рис. 6. Установка триггеров микросхемы в 0 осуществляется подачей логической 1 одновременно на два объединенных по схеме И входа R. Рабочей полярностью входных счетных импульсов, подаваемых на входы С, является отрицательная. Импульсы могут подаваться или по отдельности на каждый из входов (на второй вход должен при этом подаваться уровень логической 1), или одновременно на оба входа.
Рис. 6. Цоколевка ИС К155ИЕ1
Рис. 7. Цоколевка ИС К155ИЕ2 (а), К155ИЕ4 (б), К155ИЕ5 (в)
Одновременно с каждым десятым входным импульсом на выходе формируется равный ему по длительности выходной импульс отрицательной полярности. Многокаскадные делители частоты можно строить, соединяя входы С последующих каскадов с выходами предыдущих.
Интегральные микросхемы К.155ИЕ2, К155ИЕ4 и К.155ИЕ5 (рис. 7) содержат по четыре счетных триггера. В каждой ИС один из триггеров имеет отдельный вход С1 и прямой выход, три оставшиеся триггера соединены между собой так, что образуют делитель на 8 в ИС К155ИЕ5, на 6 в К155ИЕ4 и на 5 в К155ИЕ2. При соединении выхода первого триггера со входом С2 цепочки из трех триггеров образуются соответственно делители на 16, 12 и 10.